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外部 CFLT 用于提供充电 CSH 所需的瞬时电流，其必须至少为 20x CSH。一般而言，1nF 较为合适。RFLT 用于阻止驱动运算放大器承受纯电容性负载。这样，RFLT 和 CFLT 构建起一个时间常量为 τ = RFLTCFLT 的 RC 电路。 为了保证所有一切都及时稳定以获得的信号采集，tACQ 必须为 ≥ k τ，其中k = ln(2(N+1))。K 为一个 N 位转换器稳定至 0.5LSB 要求的时间常量值。由此，您可以确定大值 τ，以及 RFLT 的值。

当前又有一种叫作“流水线”的结构，它也是基于Flash结构的多步转换结构(分区式)，它是SAR和Flash两种相结合的一种结构。这种结构实际上是牺牲ADC的速度来换取精度，因此适于较高精度的高速ADC.

多数情况下，输入噪声越低越好，但在某些情况下，输入噪声实际上有助于实现更高的分辨率。这似乎毫无道理，不过继续阅读本指南，就会明白为什么有些噪声是好的噪声。
折合到输入端噪声（代码跃迁噪声）
实际的ADC在许多方面与理想的ADC有偏差。折合到输入端的噪声肯定不是理想情况下会出现的，它对ADC整体传递函数的影响如图1所示。随着模拟输入电压提高，“理想”ADC（如图1A所示）保持恒定的输出代码，直至达到跃迁区，此时输出代码即刻跳变为下一个值，并且保持该值，直至达到下一个跃迁区。理论上，理想ADC的“代码跃迁”噪声为0，跃迁区宽度也等于0.实际的ADC具有一定量的代码跃迁噪声，因此跃迁区宽度取决于折合到输入端噪声的量代码跃迁噪声的宽度约为1个LSB（低有效位）峰峰值。

分辨率是指AD转换器对输入信号的分辨能力，比如说 ADC0809是一个8位AD。当对其输入5V的模拟电压时，其转化后输出的数字量为FFH(255),那么其分辨率为5/255=0.0196v（约等于0.02v）也就是说模拟量的输入必须以0.02为单位变大或变小，其输出的数字量才会有变化，例如：4.98~5.00的模拟量其输出数字量都为FFH.
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