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分辨率是指AD转换器对输入信号的分辨能力，比如说 ADC0809是一个8位AD。当对其输入5V的模拟电压时，其转化后输出的数字量为FFH(255),那么其分辨率为5/255=0.0196v（约等于0.02v）也就是说模拟量的输入必须以0.02为单位变大或变小，其输出的数字量才会有变化，例如：4.98~5.00的模拟量其输出数字量都为FFH.

外部 CFLT 用于提供充电 CSH 所需的瞬时电流，其必须至少为 20x CSH。一般而言，1nF 较为合适。RFLT 用于阻止驱动运算放大器承受纯电容性负载。这样，RFLT 和 CFLT 构建起一个时间常量为 τ = RFLTCFLT 的 RC 电路。 为了保证所有一切都及时稳定以获得的信号采集，tACQ 必须为 ≥ k τ，其中k = ln(2(N+1))。K 为一个 N 位转换器稳定至 0.5LSB 要求的时间常量值。由此，您可以确定大值 τ，以及 RFLT 的值。

大多数高精度模数转换器 (ADC) 都没有高阻抗输入。输入信号直接通过一个开关连接到一个采样电容器。这种负载存在一些有趣的挑战。
有人试图通过直接连接一个电位计到输入来验证其 ADC 的运行。这样做的结果通常让人失望，因为获得的结果并不理想。这种情况下，在 ADC 输入上看到的信号呈现出巨大的峰值，因为大输入阻抗从采样电容器吸取电流，从而导致对电容器充电需要大量的电流。如果在转换器的采集时间 tACQ 内稳定下来，便不会出现问题。但是，如果没有在 tACQ 内稳定到 0.5 低有效位 (LSB) 以下，则会损耗精度。

目前的高速ADC主要采用了以下两种结构形式。一种是全并行结构，也叫Flash结构。这种结构的ADC至少有2"-1个比较器，例如，一个八位ADC就至少有255个比较器。当ADC分辨率增加时，不仅电路体积庞大，而且功耗猛增，也易出现“火花码’，，因而一般用于分辨率较低的ADC，如六位、八位ADC.另一 种 结 构形式称为分区式结构或折叠式结构，如两步法、多步法。其电路结构主要包含了S/H(或T/H)放大器、Flash A/D转换器、时标电路及数字误差校正电路等。分区式结构ADC克服了纯Flash结构ADC随着分辨率增加，电路体积庞大、功耗猛增的缺点但又带来另一个问题，即差分放大器和其中与*二次转换处理输入电压有关的电路引入的误差，这些误差将**过转换器允许的误差，因此必须引入数字误差校正。
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