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折合到输入端噪声对ADC“接地输入端”直方图的影响（ADC具有少量DNL）
虽然ADC固有的微分非线性（DNL）可能会导致其噪声分布与理想的高斯分布有细微的偏差显示了部分DNL），但它至少大致呈高斯分布。如果DNL比较大，则应计算多个不同直流输入电压的­值，然后求平均值。例如，如果代码分布具有较大且特的峰值和谷值，则表明ADC设计不佳，或者更有可能的是PCB布局布线错误、接地不良、电源去耦不当。当直流输入扫过ADC输入电压范围时，如果分布宽度急剧变化，这也表明存在问题。

代码跃迁噪声（折合到输入端噪声）及其对ADC传递函数的影响
由于电阻噪声和“kT/C”噪声，所有ADC内部电路都会产生一定量的均方根（RMS）噪声。即使是直流输入信号，此噪声也存在，它是代码跃迁噪声存在的原因。如今通常把代码跃迁噪声称为“折合到输入端噪声”，而不是直接使用“代码跃迁噪声”这一说法。折合到输入端噪声通常用ADC输入为直流值时的若干输出样本的直方图来表征。大多数高速或高分辨率ADC的输出为一系列以直流输入标称值为中心的代码。为了测量其值，ADC的输入端接地或连接到一个深度去耦的电压源，然后采集大量输出样本并将其表示为直方图（有时也称为“接地输入”直方图）。由于噪声大致呈高斯分布，因此可以计算直方图的标准差σ­，它对应于有效输入均方根噪声。参考文献1详细说明了如何根据直方图数据计算σ值。该均方根噪声虽然可以表示为以ADC满量程输入范围为基准的均方根电压，但惯例是用LSB rms来表示

外部 CFLT 用于提供充电 CSH 所需的瞬时电流，其必须至少为 20x CSH。一般而言，1nF 较为合适。RFLT 用于阻止驱动运算放大器承受纯电容性负载。这样，RFLT 和 CFLT 构建起一个时间常量为 τ = RFLTCFLT 的 RC 电路。 为了保证所有一切都及时稳定以获得的信号采集，tACQ 必须为 ≥ k τ，其中k = ln(2(N+1))。K 为一个 N 位转换器稳定至 0.5LSB 要求的时间常量值。由此，您可以确定大值 τ，以及 RFLT 的值。

随着计算机技术、通信技术和微电子技术的高速发展，大大促进了ADC技术的发展，ADC作为模拟量与数据量接口的关键部件，广泛应用于各领域，在信息技术中起着重要作用。ADC同计算机一样，经历了低速到高速的发展过程。ADC的低速(转换时间大于300uS )结构有积分型、斜坡型、跟踪型;ADC的中速(转换时间在1uS-300uS )结构有逐次逼近型;ADC的高速(转换时间小于于1uS)结构有闪烁型、分区式以及高分辨率结构的∑-△型。这些不同的结构满足了实际应用的广泛性和多样性的需求，其中高速ADC已成为决定诸如、通信、电子对抗、航天航空、、测控、地展、、仪器仪表、图象、高性能控制器及数字通信系统等现代化电子设备性能的重要环节。
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